mini2440学习之2440时钟配置解

文章由LinuxBoy分享于2019-03-31 12:03:50热评（581）

在移植Nboot时，发现串口输出乱码，检查串口配置没问题后，觉得应该是时钟配置没配好，修改后果然ok，所以补习一下！

2440时钟配置详细说明，以上电为顺序讲述：

一、S3C2440A时钟概述

1、S3C2440A的电源管理有4种模式：NORMAL，SLOW，IDLE，SLEEP。

2、有4种时钟：FCLK，HCLK，PCLK，UCLK具体分工如下：

FCLK is used by ARM920T.

HCLK is used for AHB bus, which is used by the ARM920T, the memory controller, the interrupt controller, the LCD

controller, the DMA and USB host block.

PCLK is used for APB bus, which is used by the peripherals such as WDT, IIS, I2C, PWM timer, MMC interface,

ADC, UART, GPIO, RTC and SPI.

UCLK专门为USB供电，有UPLL输出。

3、有两个锁相环，一个MPLL负责FCLK，HCLK，PCLK，一个UPLL负责USB的48MHz，通过三个倍频因子MDIV、PDIV和SDIV来设置倍频。

二、S3C2440A时钟上电过程

1、主时钟源可以由外部时钟（EXTCLK）或者外部晶振（XTIPll）提供，时钟源由模式控制引脚OM3和OM2选择，在复位信号

的上升沿检测OM3和OM2引脚状态并锁定在OM[3:2]中。

2、我们可以在程序开头启动MPLL，在设置MPLL的几个寄存器后，需要等待一段时间(Lock Time)，MPLL的输出才稳定。在这段

(Lock Time)时间内，FCLK停振，CPU停止工作。Lock Time的长短由寄存器LOCKTIME设定。Lock Time之后，MPLL输出平

稳。在上电没有设置MPLL时，系统时钟为晶振时钟。

三、S3C2440A时钟配置流程和样例

1、设置S3C2440A的时钟频率需要配置4个寄存器：LOCKTIME（0x4C000000）、CLKDIVN （0x4C000014）、MPLLCON

（ 0x4C000004）、UPLLCON（0x4C000008）。

2、时钟配置顺序如上：LOCKTIME => CLKDIVN => MPLLCON => UPLLCON。注意：UPLL的设置要先于MPLL，切超前7个时钟

设置。

3、时钟样例：

（1）、LOCKTIME：位[31:16]用于UPLL，位[15:0]用于MPLL。确省值为0xFFFFFFFF

（2）、CLKDIVN：DIVN _UPLL[3]：HDIVN [2:1]：PDIVN [0]用来设置FCLK：HCLK：PCLK的比例关系，默认为1:1:1。

CLKDIVN不同的设置及对应的时钟比例关系如下图：

图HDIVN 和PDIVN对应的比例，HCLK4_HALF和HCLK3_HALF在摄像头CAMDIVN寄存器中。

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